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References
gen/lib/Target/Mips/MipsGenAsmMatcher.inc 4195 case Mips::A2: OpKind = MCK_Reg13; break;
gen/lib/Target/Mips/MipsGenCallingConv.inc 247 Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3
300 Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3
484 Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3, Mips::T4, Mips::T5, Mips::T6, Mips::T7, Mips::T8, Mips::V1
496 Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3, Mips::T4, Mips::T5, Mips::V1
gen/lib/Target/Mips/MipsGenRegisterInfo.inc 1618 { Mips::A2 },
1967 Mips::ZERO, Mips::AT, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3, Mips::T4, Mips::T5, Mips::T6, Mips::T7, Mips::S0, Mips::S1, Mips::S2, Mips::S3, Mips::S4, Mips::S5, Mips::S6, Mips::S7, Mips::T8, Mips::T9, Mips::K0, Mips::K1, Mips::GP, Mips::SP, Mips::FP, Mips::RA,
1997 Mips::ZERO, Mips::AT, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3, Mips::T4, Mips::T5, Mips::T6, Mips::T7, Mips::S0, Mips::S1, Mips::S2, Mips::S3, Mips::S4, Mips::S5, Mips::S6, Mips::S7, Mips::T8, Mips::T9, Mips::K0, Mips::K1, Mips::GP, Mips::SP, Mips::FP, Mips::RA,
2027 Mips::AT, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::T0, Mips::T1, Mips::T2, Mips::T3, Mips::T4, Mips::T5, Mips::T6, Mips::T7, Mips::S0, Mips::S1, Mips::S2, Mips::S3, Mips::S4, Mips::S5, Mips::S6, Mips::S7, Mips::T8, Mips::T9, Mips::K0, Mips::K1, Mips::GP, Mips::SP, Mips::FP, Mips::RA,
2037 Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::S0, Mips::S1, Mips::SP,
2047 Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3, Mips::S0, Mips::S1,
2067 Mips::S0, Mips::S1, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3,
2087 Mips::ZERO, Mips::S1, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3,
2097 Mips::S1, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3,
2117 Mips::A1, Mips::A2, Mips::A3, Mips::S5, Mips::S6,
2167 Mips::A1, Mips::A2, Mips::A3,
2177 Mips::A0, Mips::A1, Mips::A2,
2197 Mips::A1, Mips::A2,
2908 { Mips::A2, 6U },
3112 { Mips::A2, 6U },
7400 static const MCPhysReg CSR_Interrupt_32_SaveList[] = { Mips::A3, Mips::A2, Mips::A1, Mips::A0, Mips::S7, Mips::S6, Mips::S5, Mips::S4, Mips::S3, Mips::S2, Mips::S1, Mips::S0, Mips::V1, Mips::V0, Mips::T9, Mips::T8, Mips::T7, Mips::T6, Mips::T5, Mips::T4, Mips::T3, Mips::T2, Mips::T1, Mips::T0, Mips::RA, Mips::FP, Mips::GP, Mips::AT, Mips::LO0, Mips::HI0, 0 };
7402 static const MCPhysReg CSR_Interrupt_32R6_SaveList[] = { Mips::A3, Mips::A2, Mips::A1, Mips::A0, Mips::S7, Mips::S6, Mips::S5, Mips::S4, Mips::S3, Mips::S2, Mips::S1, Mips::S0, Mips::V1, Mips::V0, Mips::T9, Mips::T8, Mips::T7, Mips::T6, Mips::T5, Mips::T4, Mips::T3, Mips::T2, Mips::T1, Mips::T0, Mips::RA, Mips::FP, Mips::GP, Mips::AT, 0 };
7408 static const MCPhysReg CSR_Mips16RetHelper_SaveList[] = { Mips::V0, Mips::V1, Mips::FP, Mips::A3, Mips::A2, Mips::A1, Mips::A0, Mips::S7, Mips::S6, Mips::S5, Mips::S4, Mips::S3, Mips::S2, Mips::S1, Mips::S0, Mips::D15, Mips::D14, Mips::D13, Mips::D12, Mips::D11, Mips::D10, 0 };
lib/Target/Mips/AsmParser/MipsAsmParser.cpp 2237 bool RegPair = ((R0 == Mips::A1 && R1 == Mips::A2) ||
2239 (R0 == Mips::A2 && R1 == Mips::A3) ||
2243 (R0 == Mips::A0 && R1 == Mips::A2) ||
3151 case Mips::A1: return Mips::A2;
3152 case Mips::A2: return Mips::A3;
5248 return Mips::A2;
5274 case Mips::F6: return Mips::A2;
5313 case Mips::COP06: return Mips::A2;
lib/Target/Mips/Disassembler/MipsDisassembler.cpp 2496 Inst.addOperand(MCOperand::createReg(Mips::A2));
2503 Inst.addOperand(MCOperand::createReg(Mips::A2));
2520 Inst.addOperand(MCOperand::createReg(Mips::A2));
lib/Target/Mips/MCTargetDesc/MipsABIInfo.cpp 25 static const MCPhysReg O32IntRegs[4] = {Mips::A0, Mips::A1, Mips::A2, Mips::A3};
119 Mips::A0, Mips::A1, Mips::A2, Mips::A3
lib/Target/Mips/MCTargetDesc/MipsMCCodeEmitter.cpp 1080 MI.getOperand(1).getReg() == Mips::A2)
1085 else if (MI.getOperand(0).getReg() == Mips::A2 &&
1098 MI.getOperand(1).getReg() == Mips::A2)
lib/Target/Mips/MicroMipsSizeReduction.cpp 380 Mips::AT, Mips::V0, Mips::V1, Mips::A0, Mips::A1, Mips::A2, Mips::A3,
587 if (Reg == Mips::A0 || Reg == Mips::A1 || Reg == Mips::A2 ||
601 (R0 == Mips::A0 && R1 == Mips::A2) ||
603 (R0 == Mips::A1 && R1 == Mips::A2) ||
605 (R0 == Mips::A2 && R1 == Mips::A3))
lib/Target/Mips/MipsAsmPrinter.cpp 927 EmitMovFPIntPair(STI, MovOpc, Mips::A2, Mips::A3, Mips::F14, Mips::F15, LE);
934 EmitMovFPIntPair(STI, MovOpc, Mips::A2, Mips::A3, Mips::F14, Mips::F15, LE);
938 EmitInstrRegReg(STI, MovOpc, Mips::A2, Mips::F14);
lib/Target/Mips/MipsFastISel.cpp 1193 VA.convertToReg(Mips::A2);
1334 std::array<MCPhysReg, 4> GPR32ArgRegs = {{Mips::A0, Mips::A1, Mips::A2,
lib/Target/Mips/MipsISelLowering.cpp 2743 static const MCPhysReg IntRegs[] = { Mips::A0, Mips::A1, Mips::A2, Mips::A3 };
2749 static const MCPhysReg FloatVectorIntRegs[] = { Mips::A0, Mips::A2 };
2798 if (Reg == Mips::A2)
2883 assert((Reg == Mips::A0) || (Reg == Mips::A2));